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| 设计了一种多通道同步采集存储测试系统，利用CPLD（复杂可编程逻辑器件）和单路FIFO（先入先出存储器）缓存实现了四路ADC同步转换数据到FLASH存储器的数据存储方式。此设计方案实现了在采样速率变化的情况下， FIFO自适应完成缓存速率调整的功能，并且多通道数据能连续不间断地存储到FLASH存储器中。这对于多通道变采样的存储测试系统设计具有一定的借鉴意义。 |
| 关键词: 同步采集 CPLD FIFO 自适应 |
| DOI：10.7667/j.issn.1674-3415.2010.08.022 |
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